ファイル:FPGA cell example.png

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元のファイル ‎(957 × 430 ピクセル、ファイルサイズ: 7キロバイト、MIME タイプ: image/png)

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概要

解説
English: An example of how an FPGA logic cell can look like, incl a 4 inp. LUT (or two 3-LUTs), a Full Adder and a D-type Flip Flop. The 2 muxes to the right have their select signal set during the programming of the cell.
Svenska: Exempel på hur en logisk cell i en FPGA kan vara uppbyggd, inkl. en 4-LUT (eller två 3-LUTar), en Fulladderare och en D-flip-flop. De två muxarna till höger får sina select-signaler satta vid programmeringen av cellen.
日付
原典 投稿者自身による著作物
作者 Petter.kallstrom


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題材

成立日

2 5 2010

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日付と時刻サムネイル寸法利用者コメント
現在の版2010年5月2日 (日) 17:202010年5月2日 (日) 17:20時点における版のサムネイル957 × 430 (7キロバイト)Petter.kallstrom{{Information |Description={{en|1=An example of how an FPGA logic cell can look like, incl a 4 inp. LUT (or two 3-LUTs), a Full Adder and a D-type Flip Flop. The 2 muxes to the right have their select signal set during the programming of the cell.}} {{sv|

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グローバルなファイル使用状況

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